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2023-05-20 发布于北京
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一种芯片(100)，该芯片(100)包括：互连层(110)和设置在该互连层(110)上的多个裸片，该多个裸片包括第一裸片(1)和第二裸片(2)，第一裸片(1)和第二裸片(2)之间通过边缘区域直接进行走线互联，其中，该边缘区域指示该互连层(110)中边框以外的区域，该边框指示该多个裸片在该互连层(110)中的外围边界。由于该互连层中(110)上述边缘区域没有信号走线，不会受到其他数据信号的干扰，因此，第一裸片(1)和第二裸片(2)之间通过边缘区域走线互联，可以降低这两个裸片之间传输数据信号的延时，

(19)国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 114930524 A (43)申请公布日 2022.08.19 (21)申请号 201980101374.3 (22)申请日 2019.10.16 (85)PCT国际申请进入国家阶段