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本发明公开了一种多进多出FIFO,包括控制单元fifo_ctl和数据存储单元fifo_dp,控制单元fifo_ctl的输出端和数据存储单元fifo_dp之间连接有信号wren、读指针rptr和写指针wptr一共三组信号,本发明能够支持上下游流量控制的FIFO队列的多进多出,实现数据的快速缓存和流量控制,适用于多种场景;本发明还提供一种针对该多进多出FIFO的可配置的设计方法,能够实现多进多出FIFO的设计工作的可配置化,通过一次编写python代码,即可实现多种FIFO队列,可以极大加速设计过程
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112181356 A
(43)申请公布日 2021.01.05
(21)申请号 202011043662.9
(22)申请日 2020.09.28
(71)申请人 中国
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