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本发明涉及一种适用于多种数据带宽的加密模块，属于数字芯片设计技术领域。本发明设计的加密模块通过配置接口、总线接口、控制单元、FIFO存储器、数据寄存器、加解密算法单元等单元的协同工作，支持高速、低速两条独立的加密通道；支持加密数据的DMA功能，减少处理器负载；支持处理器配置的单次加解密功能，提供更多的低速数据的加解密方式选择；支持部分单元可裁剪，根据具体应用场景降低加密模块使用资源。本发明的加密模块可适用多种数据带宽的数据加解密，并支持可裁剪处理，从而增强加密模块的功能适应性，提高数字芯片的设计
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112214795 A
(43)申请公布日 2021.01.12
(21)申请号 202011092962.6
(22)申请日 2020.10.13
(71)申请人 天津津航计算技术研究所
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