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2023-05-27 发布于四川
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一种基于FPGA多通道数据同步电路.pdf

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本发明公开了一种基于FPGA多通道数据同步电路。多通道数据同步电路由延迟电路、串并转换电路、比较电路组成。首先，电路输入的串行数据连接至延迟电路的输入端，延迟电路对数据进行一定时间的延迟，延迟电路的输出端与串并转换电路的输入端相连；其次，串并转换电路将输入的延迟数据转换为并行数据，串并转换电路的输出端连接至比较电路的输入端；最后，比较电路根据输入的并行数据计算各个通道的延迟信息，并输出延迟控制信号至延迟电路。延迟控制信号调整延迟电路中各个通道的延迟时间，同时输出同步数据。本发明可实现多通道数据同

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 112327693 A (43)申请公布日 2021.02.05 (21)申请号 202011206349.2 (22)申请日 2020.11.02 (71)申请人南京理工大学地址

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