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本发明属于大规模集成电路电子设计技术领域。为缩短位流生成花费的时间，提高位流生成的效率，本发明提供了可编程器件的位流并行生成方法及系统，对位流模型文件和网表文件进行解析，对瓦片(tile)配置比特点阵列中的配置比特点进行并行计算，将并行计算得到的配置数据合并，计算或更新所有全局配置比特点的配置数据，生成位流文件的文件头部信息和配置生成命令字信息，以及生成位流文件。本发明的方法及系统并行的位流生成技术，比传统的位流生成工具速度快，效率更高，更适用于现在的超大规模FPGA；通用性强，能够应用于多种结
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 112307700 B
(45)授权公告日 2022.07.29
(21)申请号 201911299816.8 CN 107390116 A,2017.11.24
(22)申请日 20
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