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2023-05-28 发布于四川
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本发明提供了一种基于FPGA的嵌入式数据缓存系统，包括FPGA软核、DDR控制器和Dcache模块，所述FPGA软核与所述DDR控制器、所述Dcache模块通过总线通信连接；所述DDR控制器用于对外部DDR的数据访问；所述Dcache模块用于进行数据的强制刷新或强制写回；所述FPGA软核发送强制刷新或强制回写指令，所述Dcache模块接收强制刷新将所述Dcache模块中的Tag清零，或所述Dcache模块接收强制回写指令将所述Dcache模块中的数据回写至DDR。本发明利用FPGA软核发送强制回

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 112347031 A (43)申请公布日 2021.02.09 (21)申请号 202011018471.7 (22)申请日 2020.09.24 (71)申请人深圳市紫光同创电子有限公司

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