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本发明涉及一种实用的逻辑验证架构级FPGA布线器的构建方法,步骤S1:生成每个线网的布线拓扑:首先对线网进行布线拓扑,在TDM比例未分配前,对于每个线网,其所包含的FPGA在该阶段被连接在一起,用以线网的连通性;步骤S2:进行TDM比例分配:根据每个线网组的时延情况的不同,为每个线网的每条边分配TDM比例;步骤S3:进行系统时延优化:通过迭代的方式,不断地将具有较大TDM比例的线网组进行,当满足迭代终止的条件时,整个布线器的处理过程结束。本发明能够通过降低相应的系统延迟来提高芯片性能。
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 112364590 B
(45)授权公告日 2022.08.09
(21)申请号 202011175892.0 G06F 30/394 (2020.01)
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