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一种电路布置包含MAC电路(200‑0，200‑1，200‑2，200‑15，200‑n，201‑0，201‑1，201‑2，201‑15，201‑n，202‑0，202‑1，202‑2，202‑15，202‑n，231‑0，231‑1，231‑2，231‑15，231‑n)的阵列(106)，其中每个MAC电路包含配置成存储多个核的缓存(332)。所述MAC电路配置成以第一速率接收IFM的第一组数据元素(718)。所述MAC电路配置成在第一MAC周期(710)期间对所述第一组所述数据元素和所述核
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112424745 A
(43)申请公布日 2021.02.26
(21)申请号 201980047920.X (74)专利代理机构 北京市君合律师事务所
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