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本公开的实施例涉及用于存储器模块的动态随机存取存储器(DRAM)部件。该存储器模块包括模块接口；第一存储器部件堆叠，包括第一数据接口，被耦合到模块接口；以及第二数据接口；第二存储器部件堆叠，包括第三数据接口，被耦合到第一堆叠的所述第二数据接口，其中所述第二数据接口和所述第三数据接口利用线性链中的点对点拓扑被连接；以及第四数据接口；以及命令和地址(CA)接口，被耦合到所述第一堆叠和第二堆叠，其中，所述CA接口用于从存储器控制器接收第一命令和第二命令；控制所述模块接口处的第一访问插槽的定时，以用于与
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112687304 A
(43)申请公布日 2021.04.20
(21)申请号 202010905199.8 (74)专利代理机构 北京市金杜律师事务所
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