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本申请实施例提供了一种加解密方法和装置、电子设备以及计算机可读存储介质。该方法包括:获取用于进行加解密运算的第一数据;将所述第一数据拆分为多个第一子数据;将所述多个第一子数据与第二数据输入至FPGA内的至少一个乘法器;一个时钟周期内并行执行所述多个第一子数据与所述第二数据的乘法操作,并将乘法结果进行加法操作;将所述加法操作的结果输出作为所述第一数据与第二数据的模乘运算结果;以及根据所述模乘运算结果进行加解密操作。本申请实施例通过在模乘运算中将长位宽的第一数据拆解为多个低位宽的子数据并能够在一个时
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112711395 A
(43)申请公布日
2021.04.27
(21)申请号 20191
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