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本发明涉及一种基于菊花链的时钟偏斜校准系统、方法、设备及计算机存储介质，该系统包括至少两个相互独立的时钟通道单元，至少一个鉴相器，至少一个状态机；所述时钟单元包括可控延迟链单元和驱动单元。在每两个相邻的通道放置一个鉴相器，然后校准状态机根据该鉴相器的输出调整每个时钟通道上的可控延迟链，直到这两个通道输出偏斜足够小为止；按照这种方式依次校准所有通道：通道0+通道1，通道1+通道2，通道2+通道3。根据我们以前的项目经验，65nmCMOS工艺下这种方式可以将相邻通道偏斜校准到1ps以内，180nm
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112737573 A
(43)申请公布日 2021.04.30
(21)申请号 202011517775.8
(22)申请日 2020.12.21
(71)申请人 南京极景微半导体有限公司
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