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用于半导体存储器中的时钟调平的设备及方法.pdfVIP

用于半导体存储器中的时钟调平的设备及方法.pdf

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    本发明揭示用于半导体存储器中的时钟调平的设备及方法。在实例设备中，延时控制电路经配置以在第一及第二模式中基于延时信息及系统时钟提供具有一时序的有效第一控制信号。时钟调平控制电路经配置以响应于有效第一控制信号在第一时钟的时钟转变处而在所述第一模式中提供有效第二控制信号，且进一步经配置以响应于所述有效第一控制信号在第二时钟的转变处而在所述第二模式中提供时钟调平反馈。读取时钟电路经配置以响应于所述有效第二控制信号而提供多相时钟。串行器电路经配置以基于来自所述读取时钟电路的所述多相时钟使数据串行化以串行

    (19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 112820333 A (43)申请公布日 2021.05.18 (21)申请号 202011239298.3 (22)申请日 2020.11.09 (30)优先权数据 16/685,70

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