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本发明涉及一种三维存储器的控制方法,三维存储器包括多个存储串和多条字线,每个存储串包括自上而下依次串联的多个存储单元,每条字线与每个存储串中相同位置的存储单元相连,控制方法包括:在编程操作的预充电阶段,同时对与每个存储串中位于底部的至少一个虚设存储单元相连的至少一条虚设字线、与每个存储串的至少一个底部选择管相连的底部选择栅以及与每个存储串的底部相连的阵列共源极进行预充电操作;其中,对至少一条虚设字线进行预充电操作的时间小于对底部选择栅或阵列共源极进行预充电操作的时间,预充电操作清除至少一个虚设存
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112863564 A
(43)申请公布日 2021.05.28
(21)申请号 202110193612.7
(22)申请日 2021.02.20
(71)申请人 长江
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