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本发明涉及一种继电保护装置及SV直采的重采样方法，FPGA接收SV报文，对过滤后的SV报文打上时间戳并发送给驱动；驱动回调应用程序将SV原始报文进行一级缓存；应用程序对各组SV报文的时间戳减除额定延时后进行二次缓存；当重采样中断时，在二次缓存的缓存区中查找滤波计算需要的重采样时刻Ts若干采样数据；采样数据均为正常数据则滤波计算出重采样数据；否则进行修正，修正失败则标记采样数据的品质异常。本发明依据链路正常的SV的额定延时动态调整重采样前推时刻而非固定的前推合并单元最大延时，能最大程度降低合并单元
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113010532 A
(43)申请公布日 2021.06.22
(21)申请号 202110220427.2 G06F 16/2455 (2019.01)
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