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本发明提供一种减小高速电路信号串扰的方法、系统、设备及印制电路板,所述方法包括:S1,获取差分线形成的多条串扰性能分析初始曲线;S2,基于端口电压、端口输入电压、端口阻抗、差分线阻抗的函数关系调节差分线的至少一个参数;S3,获取基于调节参数后的差分线形成的多条串扰性能分析仿真曲线;S4,对比所述多条串扰性能分析仿真曲线与所述多条串扰性能分析初始曲线;S5,在所述多条串扰性能分析仿真曲线的性能参数优于所述多条串扰性能分析初始曲线的性能参数时,获取所述差分线的当前参数,并将所述差分线的当前参数确定印
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113033129 A
(43)申请公布日 2021.06.25
(21)申请号 202110236823.4
(22)申请日 2021.03.03
(71)申请人 加弘
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