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2023-06-13 发布于四川
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一种寄存器窗的微架构.pdf

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本发明提供一种寄存器窗微架构，基于分布式层叠结构，支持向量、矩阵或张量等规整的循环计算加速。微架构设计包括：分支‑合并指令译码器，一个主寄存器窗（GPR），一个或多个副寄存器窗（SPR_A、SPR_B等等，如图1所示），一个或多个循环体加速指令序列（ITER_1、ITER_2等等）。SPR与GPR共享同样的寄存器命名，分支指令将程序切换到指定副寄存器窗执行，多个ITER指令序列在各自寄存器窗并行执行，合并指令将各ITER指令序列结果从副寄存器窗合并回到主寄存器窗。

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 113095031 A (43)申请公布日 2021.07.09 (21)申请号 202110272920.9 (22)申请日 2021.03.12 (71)申请人苏州芯启微电子科技有限公司

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