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一实施方式的半导体存储装置具备行解码器及存储单元阵列,所述存储单元阵列具备第1功能块。第1功能块具备:第1区域(CEL);第2区域(WLHU),在第1方向(Y方向)上与第1区域(CEL)相邻;及第3区域(CNCT),连接第1区域(CEL)与第2区域(WLHU)。存储单元阵列还具备:第1绝缘层(730),填埋第1区域(CEL)与第2区域(WLHU)之间的第1槽(DY),且与第3区域(CNCT)相接;第1接触插塞(CP12),设置在第1绝缘层(730)中,且与行解码器电连接;及第1配线层(IC1),
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113113055 A
(43)申请公布日 2021.07.13
(21)申请号 202110395832.8 G11C 8/12 (2006.01)
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