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一种存储器件,具有多个位单元,该多个位单元中的每个包括SRAM单元,该SRAM单元具有响应于在第一字线上接收的控制信号而选择性地可连接到第一位线的存储节点。每个位单元还包括MRAM单元,该MRAM单元响应于在第二字线上接收的控制信号而选择性地可连接到SRAM单元的存储节点。本发明的实施例还涉及操作存储器件的方法。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113129964 A
(43)申请公布日 2021.07.16
(21)申请号 202011624186.X
(22)申请日 2020.12.31
(30)优先权数据
62/955,53
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