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本发明公开了一种利用多裸片FPGA布局结果的网表分割方法,涉及FPGA技术领域,该方法从布局角度出发,用差异性时序模型来模拟裸片内部和裸片间的时序代价差异,然后基于差异性时序模型以整个用户输入网表和全芯片结构来看待子网表划分的时序代价函数,然后根据时序驱动布局结果对用户输入网表分割,该方法利用布局算法来解决网表分割时的各个子网表的逻辑资源数量约束及子网表指定分配到哪个裸片的问题,以增加布局约束条件的方式来处理约束分割网表间连接关系数量限制的问题,从而可以快速有效的满足时序设计和资源约束。
(19)中华人民共和国国家知识产权局
(12)发明专利
(10)授权公告号 CN 113128151 B
(45)授权公告日 2022.02.18
(21)申请号 202110429194.7 CN 102768506 A,2012.11.07
(22)
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