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本发明涉及抗闩锁技术领域，尤其是一种避免处理器上电过程中I/O口闩锁的电路，包括控制单元、处理器、上电控制开关、接地开关和释放开关，控制单元上电后，第一信号节点、第二信号节点、第三信号节点和第四信号节点依顺序输出触发信号；第一信号节点输出的触发信号使接地开关保持导通；第二信号节点输出的触发信号使上电控制开关保持导通；第三信号节点输出的触发信号使处理器复位；第四信号节点输出的触发信号使对接地开关的触发端对地短接，释放信号。本发明在启动处理器前先拉低其I/O口端的电平状态，使处理器上电启动以及复位均
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113176749 A
(43)申请公布日 2021.07.27
(21)申请号 202110442238.X
(22)申请日 2021.04.23
(71)申请人 广东天波信息技术股份有限公司
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