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本发明提供一种可重构的限幅衰减一体化电路及其工作方法,所述可重构的限幅衰减一体化电路包括基片材料,以及集成在基片材料表面的PIN二极管一、PIN二极管二、PIN二极管三、场效应管FET1、隔直电容一、隔直电容二、隔直电容三、隔直电容四、吸收电阻R1、吸收电阻R2、串联电阻R3、限流电阻R4、扼流电感L1、扼流电感L2、扼流电感L3、扼流电感L4、输入传输线、输出传输线、匹配传输线、接地金属孔一、接地金属孔二、接地金属孔三、接地金属孔四和接地金属孔五。本发明的可重构的限幅衰减一体化电路采用PIN二
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 113300682 B
(45)授权公告日 2022.05.17
(21)申请号 202110617833.2 (56)对比文件
(22)申请日 2021.06.03
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