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本公开提供一种具有在不同位面的微图案的半导体元件结构及其制备方法,其是可避免所述多个微图案的塌陷并降低在所述多个微图案之间的寄生电容。该半导体元件结构具有一基底;一第一目标结构,设置在该基底上,其中该第一目标结构包括一第一部分、一第二部分以及一第三部分,该第一部分的一高度与该第二部分的一高度大于该第三部分的一高度;一第二目标结构,设置在该第一目标结构上,其中该第二目标结构包括一第四部分、一第五部分以及一第六部分;一低位面导电图案,位于该第一目标结构与该第二目标结构之间;以级一高位面导电图案,位于
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113363237 A
(43)申请公布日 2021.09.07
(21)申请号 202110230787.0
(22)申请日 2021.03.02
(30)优先权数据
16/811,82
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