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本发明涉及一种内存控制方法和装置,属于通信技术领域,解决了现有技术中由于FPGA的缓存较小,当数据双向传输速率过高时,中断频率也随之升高等的问题。内存控制方法包括:申请物理地址连续的上位机内存片区域并划分为相等的两个内存空间并且每个内存空间包括第一组内存片和第二组内存片;开辟三块内存以形成三个内存池,其中,第一内存池用于管理所有内存片的首地址;在FPGA内开辟三块缓存用于在数据传输时传递内存片地址;FPGA从第一内存池取出第一内存空间中第一组内存片或第二组内存片的首地址并放入第一缓存中;以及FP
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113360420 A
(43)申请公布日
2021.09.07
(21)申请号 20201
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