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本发明公开一种基于硬件加速的运算电路系统及芯片，该运算电路系统包括开平方迭代模块和倒数迭代模块；开平方迭代模块，用于倒数迭代运算的结束标志有效且开平方迭代运算的结束标志无效时，控制预先设置的待开方数和倒数迭代模块输出的符合预设收敛条件的倒数结果相乘以进行预定精度的开平方迭代运算；倒数迭代模块，用于在倒数迭代运算的使能标志有效时，在当前一级倒数迭代运算中，控制倒数迭代模块在上一级倒数迭代运算中输出的倒数结果和开平方迭代模块在上一级开平方迭代运算中输出的平方根结果，获得倒数迭代模块输出的符合预设收敛
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 113407235 B
(45)授权公告日 2022.07.08
(21)申请号 202110719972.6 US 4999801 A,1991.03.12
(22)申请日 2021
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