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本发明公开了一种闪存控制器具有一处理器与一快取，当该处理器从一主机接收到一特定写入命令与特定数据，该处理器将该特定数据储存至该快取的一区域，该处理器产生基于主机的快取信息或基于闪存的快取信息以较少节点的方式来建立、更新或优化一二叉树以增进二元搜寻速度、减少闪存控制器中多个核心的计算量成本、最小化存取该快取的次数以降低总时间延迟，其中基于主机的快取信息指的是动态的数据长度，而基于闪存的快取信息指的是闪存芯片中一个写入单元例如一个储存页的数据长度。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113407111 A
(43)申请公布日 2021.09.17
(21)申请号 202110007160.9
(22)申请日 2021.01.05
(30)优先权数据
16/821,99
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