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公开了一种主从D触发器和包括主从D触发器的集成电路。该主从D触发器包括:主电路,其被配置成接收输入信号并且根据输入信号产生两个第一中间信号;传输电路,其连接至主电路,并且包括至少两个逻辑门和用于将时钟信号施加到每个门的一个输入的时钟连接,其中,门被配置成根据第一中间信号和时钟信号提供两个第二中间信号;以及从电路,其连接至传输电路以从第二中间信号形成触发器的至少一个输出信号。从电路被配置成在第二中间信号具有在先前的状态对之后的预定状态对的情况下,维持由先前的状态对给出的至少一个输出信号,并且传输电
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113395057 A
(43)申请公布日 2021.09.14
(21)申请号 202110270906.5
(22)申请日 2021.03.12
(30)优先权数据
102020106
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