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本申请实施例提供了一种解速率匹配的方法及装置,所述方法包括:译码端接收编码端发送的N个比特数据,其中,编码端进行速率匹配后的数据包括X个比特数据,X个比特数据由所述编码端通过M次发送至译码端,且每次发送N个比特数据,所述X、M和N为正整数,所述X大于或等于所述N,并行计算N个比特数据对应的存储地址,将N个比特数据分别存储至对应的存储地址。通过本申请实施例,实现了译码端实时并行计算接收数据的解速率匹配地址,进而提高了译码端的解速率匹配的效率,且不需要消耗额外的地址缓存空间。
(19)国家知识产权局
(12)发明专利
(10)授权公告号 CN 113472475 B
(45)授权公告日 2022.08.02
(21)申请号 202010239132.5 (56)对比文件
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