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2023-07-01 发布于四川
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基于FPGA进位链的电路结构优化方法及系统.pdf

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本发明提出一种基于FPGA进位链的电路结构优化方法及系统，该方法包括：通过逻辑综合工具对目标逻辑运算进行逻辑综合，得到综合网表；获取所述综合网表中关键路径；若所述关键路径上查位表的实际输入个数不大于预设阈值，且所述关键路径上参考路径两端的相邻元件为进位链，则将所述关键路径上的查位表转换为进位链，所述参考路径为连续相邻的查找表所组成的路径。本发明实施例通过查找关键路径上符合变换要求的查找表，并将查找变转换为进位链，由于进位链和查找表两个元件之间的时延较大，而进位链和进位链之间的时延较小，将相邻的进

(19)中华人民共和国国家知识产权局 (12)发明专利申请 (10)申请公布号 CN 113705135 A (43)申请公布日 2021.11.26 (21)申请号 202110819418.5 (22)申请日 2021.07.20 (71)申请人深圳市紫光同创电子有限公司

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