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本申请公开了一种正则表达式匹配方法、装置、FPGA、介质,该方法包括:接收与所述FPGA相连接的计算机设备发送的待匹配字符串;通过处于空闲状态的正则表达式匹配模块中的各个正则表达式对所述待匹配字符串进行并行匹配,得到匹配结果;将所述匹配结果发送给所述计算机设备。这样将原本由CPU执行的正则表达式匹配卸载到FPGA上,利用FPGA的高并行能力,对待匹配字符串进行并行匹配,由于在匹配过程中各个正则表达式与待匹配字符串是并行进行匹配的,所以相比于现有技术中CPU只能逐个正则表达式的进行串行匹配来说,可
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 113703715 A
(43)申请公布日 2021.11.26
(21)申请号 202111017189.1
(22)申请日 2021.08.31
(71)申请人 深信服科技股份有限公司
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