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本发明涉及芯片设计技术领域,特别涉及一种标准单元布局模型训练方法、布局方法、系统及存储介质,其中,标准单元布局模型训练方法,采用注意力层作为输入层,采用卷积层作为输出层,使用全连接层连接注意力层和卷积层,通过对标准单元的时序信息或功耗信息对布局模型进行训练,能够快速地预测局部标准单元的最优的布局,提高局部标准单元布局的效率和准确性,并且能够对已有的设计数据进行学习,进而能有效减少迭代优化次数,从而缩短设计周期。标准单元布局方法用于将训练完成的标准布局模型运用于实际芯片设计中,标准单元布局系统用于
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN117709280A
(43)申请公布日2024.03.15
(21)申请号202311705168.8
(22)申请日2023.12.11
(71)申请人华芯巨数(杭州)微电子有限公司
地
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