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2024-03-30 发布于四川
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相位和占空比矫正电路结构.pdf

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本发明公开相位和占空比矫正电路结构，包括矫正模块和寄生补偿模块，矫正模块包含鉴相器PD、电荷泵CP、低通滤波器LPF和压控延迟线VCDL；鉴相器PD的两个信号输出端与电荷泵CP的两个输入端相接，电荷泵CP的输出电压VCTL、鉴相器PD的OUT1输出信号与压控延迟线VCDL输入端耦合，压控延迟线VCDL的输出端与鉴相器PD的输入端相接并通过过寄生补偿模块PC与鉴相器PD的输出端相接，压控延迟线VCDL输出信号OUT2。本发明输入信号为存在占空比和相位失真信号IN，输出信号为与IN同相位的OUT1和

(19)国家知识产权局

(12)发明专利申请

(10)申请公布号CN117792384A

(43)申请公布日2024.03.29

(21)申请号202311660980.3H03K19/20(2006.01)

(22)申请日2023.12.

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