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本发明公开了一种针对ZUC算法的高性能硬件优化设计实现电路，属于数字电路领域，具体包括ZUC算法模块和控制模块。ZUC算法模块又包含线性反馈移位寄存器模块和有限状态自动机模块。LFSR模块，用于对输入的初始向量和初始种子密钥进行处理，并经由模加电路对存储单元进行迭代更新；FSM模块，用于对来自LFSR模块的数据进行一系列线性以及非线性的处理，最终得到向外输出的密钥流字；控制模块，根据时钟信号的变化输出一系列用于LFSR模块和FSM模块的控制信号。相较于现有技术，本发明展现出更高的吞吐性能，尤其适
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号CN118074907A
(43)申请公布日2024.05.24
(21)申请号202410394943.0
(22)申请日2024.04.02
(71)申请人湖北大学
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