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时序逻辑电路分析与设计.pdf

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    第7章时序逻辑电路的分析与设计

    组合逻辑电路在任一时刻的输出状态仅决定于该时刻各输入

    状态的组合，而与过去的输入状态无关。

    时序逻辑电路在任一时刻的输出状态依赖于该时刻的输入状态

    和电路状态的组合。

    本章介绍时序逻辑电路的的特点、分析方法和设计方法，第

    8章介绍典型的时序逻辑电路。

    7.1时序逻辑电路的特点和分类

    7.2时序电路的分析方法

    7.3时序电路的设计方法

    教学基本要求

    掌握:时序

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