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PCB
No.ItemDoneCheckNote
/Date
CheckList说明：此文件是针对1X32BIT的LPDDR3的
layout说明，性能和空间折中考虑。
PCB阻抗控制说明
1DDR单端线：50ohm±10%Y
DDR差分线：100ohm±10%
层叠结构说明
2请看附录A
分组说明
地址组：A0~A9，CK，CKE0~1，CS0~1，ODT
数据组：DQ0-DQ7，DQM0，DQS0/DQS0N为一Y
组，DQ8-DQ15，DQM1，DQS1/DQS1N为一组，
DQ组2与DQ组3类推
走线宽度说明
3单端走线线宽4mil，差分100ohm走线3.8/8.8mil；Y
电源和地网络走线尽量=8mil；
间距说明
4单端走线的线与线的间距（AirGap）≥8mil；差Y
分走线到其他线的间距≥8mil
5所有DDR信号线到其他网络、地铜皮的距离要≥Y
10mil
6数据组与地址组、数据组与数据组之间的距离要≥Y
8mil
7BGA区域里：线与线的间距（AirGap）≥4mil；Y
线与SMD焊盘的间距≥3.5mil；线与过孔的间距≥
3.5mil
等长说明
8地址组——相对于CK信号等长，误差范围为≤Y
50mil
9DQS组——相对于CK信号等长，误差范围为≤Y
500mil
10数据组——DQ0-DQ7/DMO相对于DQS0做等长，YDQM0,DQM1不符
DQ8-DQ15/DM1相对于DQS1做等长，DQ组2与DQ组3
类推，误差范围为≤50mil
11所有DDR信号线做等长时要考虑过孔长度的影响Y
12差分走线规则：差分线DQS/CK，差分正负线之间等Y
长误差范围为≤10mil
铺铜与过孔说明
13参考层要求——不能有信号线的参考层被割断的Y
现象，尽量少出现连续的过孔打断信号线的参考层
14如下图所示，SOC通过过孔扇出时，必须保证过孔Y
间的铜皮能连通。
对于0.65Pitch的SOC，在IC扇出的地方，过孔采用
8/14mils，反焊盘采用3.5mils。
对于SOC通过过孔扇出的信号必须保证回流
路径不被反焊盘打断。
如果反焊盘过大破坏了GND平面或电源平面的完整
性，那么需要在过采用手工走线连通平面，如
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