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电子技术综合实验报告
秒表设计
用
使
流
交
习
学
指导教师：
供
姓名：XX
仅
学号：XX
(一)预习内容
1、熟悉ISE的混合设计流程
2、熟悉电子秒表的工作原理和设计方法
3、熟悉教材中有关电子钟的设计过程
（二）实验目的：
1、学习Verilog的基本结构
2、学习verilog的建模结构
3、了解计时的概念以及计时的一般方法
用
4、ISE软件和modelsim软件的基本使用，能够完成编程与
仿真。使
流
（三）实验内容和要求交
复习：数字电子技术基础
习
学习：用HDL设计电子电路
学
供
学习：Xilinx的FPGA设计
仅
完成：一个设计型实验项目
（四）实验项目：计时范围为00’00”00~59’59”99，计时
结果用8只数码管显示；有两个按钮开关，一个按钮使秒表复位，
另一个按钮控制秒表的启动/暂停。
下图显示了该跑表前面板的基本排布构想。
Stopwatch
POWERRESETRUN/STOP
（五）实验内容：Verilog的语法，建模，设计时间测量的方法：
用
现在时间测量一般采用数字计器来进行
使
(六)实验原理流
交
秒表是一种常用的测时仪器。秒表的精度一般在0.1－0.2秒，计
习
时误差主要是开表、停表不准造成的。
学
秒表程序的逻辑结构较简单，它主要由显示译码器、分频器、十
供
进制计数器和六进制计数器组成。在整个秒表中最关键的是如何
仅
获得一个精确的100Hz计时脉冲，除此之外，整个秒表还需有一
个启动信号和一个归零信号，以便秒表能随意停止及启动。
秒表共有6个输出显示，分别为百分之一秒、十分之一秒、秒、
十秒、分、十分，所以共有6个计数器与之相对应，6个计数器
的输出全都为BCD码输出，这样便与显示译码器的连接。
4个10进制计数器：用来分别对百分之一秒、十分之一秒、秒
和分进行计数；2个6进制计数器：用来分别对十秒和十分进行
计数；
分频率器：用来产生100Hz计时脉冲和1khz的扫描信号；显示译
码器：完成对显示的控制。各信号功能：
输入信号：
（1）代表归零，启动信号res、stop的管脚分别连接按键开关。
（2）代表扫描时钟信号clk的管
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