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触发器的概念
组合逻辑电路：任何时刻电路的输出仅取决于该时刻的输入
时序逻辑电路：任何时刻电路的输出不仅与该时刻的输入有关，还与过去的输入有关。
u数字电路的分类
组合逻辑
电路网络
存储元件单元
u时序逻辑电路的结构框图
组合逻辑电路
时序逻辑电路
存储元件
输出
输入
u触发器的定义
具有两种稳定状态，在任何时候均处于一种稳定状态的电路叫做双稳态触发器，简称触发器。
u触发器的特点
（1）具有两个稳定状态。触发器具有两个互补输出端：Q与Q。
定义：当Q=1,Q=0时，为“1”态;
当Q=0,Q=1时，为“0”态。
（2）在输入有效信号作用下，触发器可以置“1”态或“0”态。
（3）当输入有效信号消失时，仍然能够保持新的状态。
功能表、特性方程、状态图、时序图
Qn：现态，表示电路当前的状态
Qn+1=f(Qn,X)
Q：次态，表示在输入的作用后电路进入的新状态
1
n+
u触发器输入输出关系的描述方法
现态与次态指时间上的先后次序
触发器输入变量的集合
特性方程：
构成元件
逻辑功能
电路结构
钟控型
主从型边沿型
维持－阻塞型
TTL触发器
CMOS触发器
RS触发器D触发器JK触发器
u触发器的分类
内部
分类
基本RS触发器
GA
Q
Rdo
基本RS触发器可由两个“与非”门联接而成。
GB
Sd
Rd
Q
Q
结构
逻辑符号
逻辑图
符号
输出端
Sd
Q
Sdo
01
(1)若d=0,
Qn+1=1,01
(2)若d=1,Rd
Qn+1=0,Qn+1=1
(3)若Sd=1,Rd=1
{
(4)若d=0,
Qn+1=1,
则
则
若Qn
若Q
GA
101
0Q
功能分析
GB
l
101
保持
不允许
置“0”
Qn+1=Qn
Q
1
1
表达式
Qn+1=Sd+RdQn
约束条件：Rd+Sd=1
×
×
0
0
0
1
1
1
QnRS
00
01
11
10
dSdQnQn+1
真值表
╳
╳001101
卡诺图
0
1
0
1
0
1
0
1
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
dd
0
R
1
Sd
Rd
Qn+1
功能说明
0
1
1
置“1”
1
0
0
置“0”
1
1
Qn
保持
0
0
×
不定
Sd
Rd
Q
Q
功能表
当输入同时由0变为1时，输出=？
若Sd先从0变1Q=1Q=0
若Rd先从0变1Q=0Q=1
置0保持置1保持置0保持置1不允许不定置0
1
Sdo
时序图
Rd
0
Q
Q
0
GA
GB
1
Rd
1
Sd
1
同步RS触发器
由基本RS触发器及导引“与非”门部分联接而
成。
o
G1I
G2
逻辑符号
SQ
CP
RQ
G3
CPO—
结构
逻辑图
G4
Q
Q
R
S
●
R
不
G1
G2
基本RS触
Qn+1=S+Qn发器
R
_
Qn+1=S+Qn
约束条件：SR=0
R
_
触发器的状态才由R、S的状态决定
时钟条件：
CP=1
当时钟脉冲CP=1时，
当时钟脉冲CP=0时，
触发器的输出状态不变
工作原理
S
R
Qn+1=Qn
G3
G4
Q
Q
变
CP
S
0
1
1
1
SR
Qn+1
功能
00
Qn
保持
01
0
置“0”
10
1
置“1”
11
X
不定
S
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