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题目:在CACHE存储器中,当程序正在执行时,由()完成地址映射。
选项A:硬件
选项B:硬件和软件
选项C:程序员
程序员
程序员
程序员
选项D:操作系统
答案:硬件
题目:在CPU与主存之间加入Cache,能够提高CPU访问存储器的速度,一般情况下()
选项A:Cache的容量与命中率无关
选项B:Cache容量与主存越接近时,命中率越高
选项C:Cache的容量越大,命中率越高
选项D:Cache的容量越小,命中率越高
答案:Cache的容量越大,命中率越高
题目:计算机的外部设备是指()
选项A:外存设备
选项B:输入/输出设备及外存设备
选项C:输入/输出设备
选项D:除了CPU和内存以外的其它设备
答案:输入/输出设备
题目:输入/输出设备具有以下工作特点()
选项A:实时性、多样性
选项B:异步性、实时性、多样性
选项C:异步性、实时性
选项D:异步性、实时性、多样性、复杂性
答案:异步性、实时性、多样性
题目:随着CPU速度的不断提升,程序查询方式很少被采用的原因是()
选项A:CPU与外设串行工作
选项B:CPU与外设并行工作
选项C:硬件结构复杂
选项D:硬件结构简单
答案:CPU与外设串行工作
题目:如果有多个中断同时发生,系统将根据中断优先级响应优先级最高的中断请求。若要
调整中断事件的响应次序,可以利用()。
选项A:中断嵌套
选项B:中断屏蔽
选项C:中断响应
选项D:中断向量
答案:中断屏蔽
题目:在采用DMA方式的I/O系统中,其基本思想是在()之间建立直接的数据通路。
选项A:CPU与主存
选项B:CPU与外设
选项C:外设与外设
选项D:主存与外设
答案:主存与外设
题目:以下()说法是正确的。
选项A:DMA传送方式时,DMA控制器每传送一个数据就窃取一个总线周期
选项B:中断服务程序的最后一条指令是中断返回指令
选项C:中断允许时,CPU首先保护现场
选项D:DMA控制器通过中断向CPU发DMA请求信号
答案:中断服务程序的最后一条指令是中断返回指令
题目:计算机系统的输入输出接口是()之间的交接界面。
选项A:主机与外设
选项B:存储器与外设
选项C:CPU与系统总线
选项D:CPU与存储器
答案:主机与外设
题目:在统一编址方式下,就I/O设备或者内存单元而言,其I/O对应的地址()的说法
是对的。
选项A:只能固定在地址高端
选项B:要求相对固定在地址某部分
选项C:只能固定在地址低端
选项D:可随意在地址任何地方
答案:要求相对固定在地址某部分
题目:在独立编址方式下,存储单元和I/O设备是靠()来区分的。
选项A:不同的地址和指令代码
选项B:不同的数据和指令代码
选项C:不同的数据和地址
选项D:不同的地址
答案:不同的地址
题目:随着CPU速度的不断提升,程序查询方式很少被采用的原因是()
选项A:硬件结构简单
选项B:CPU与外设串行工作
选项C:硬件结构复杂
选项D:CPU与外设并行工作
答案:CPU与外设串行工作
题目:如果有多个中断同时发生,系统将根据中断优先级响应优先级最高的中断请求。若要
调整中断事件的响应次序,可以利用()。
选项A:中断向量
选项B:中断嵌套
选项C:中断屏蔽
选项D:中断响应
答案:中断屏蔽
题目:在采用DMA方式的I/O系统中,其基本思想是在()之间建立直接的数据通路。
选项A:CPU与外设
选项B:外设与外设
选项C:CPU与主存
选项D:主存与外设
答案:主存与外设
题目:以下()说法是正确的。
选项A:中断允许时,CPU首先保护现场
选项B:DMA传送方式时,DMA控制器每传送一个数据就窃取一个总线周期
选项C:DMA控制器通过中断向CPU发DMA请求信号
选项D:中断服务程序的最后一条指令是中断返回指令
答案:中断服务程序的最后一条指令是中断返回指令
题目:根据总线上传送的信息的类型不同,总线有()。
选项A:数据总线、地址总线、控制总线、外总线
选项B:数据总线、地址总线
选项C:数据总线、地址总线、控制总线
选项D:数据总线、控制总线、控制总线、部件内总线
答案:数据总线、地址总线、控制总线
题目
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