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电子信息学院
实验报告书
课程名：《电子综合设计EDA》
题目：实验5状态机控制电路设计2
实验类别【设计】
班级：
学号：
姓名：
评语：
学习态度：【很好】【较好】【一般】【较差】
程序编写：【完整】【基本完整】【部分完整】【不完整】
得出结论：【正确】【基本正确】【部分正确】【不正确】
报告书写：【规范】【较规范】【一般】【不规范】
成绩：指导教师：
批阅时间：年月日
《电子综合设计EDA》实验报告-1-
1、实验目的
（1）通过实验掌握状态机设计技术
2、实验内容、要求
已知状态机状态图如图a所示
in_a=“00”in_a=“01”
st0in_a/=“00”st1
out_a=“0101”;out_a=“1000”;
in_a=“11”
in_a/=“11”in_a/=“01”
st3st2
in_a/=“11”
out_a=“1101”;
out_a=“1100”;
in_a=“11”
图a状态图
clkc_state
out_a
REGCOM
resetn_state
in_a
图b状态机结构图
要求：
1、试判断该状态机类型，并说明理由。根据状态图，写出对应于结构图b，分别由
主控组合进程和主控时序进程组成的verilog有限状态机设计。
2、编写verilog测试程序，验证编写的状态
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