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II
基于CPLD数字系统开发板外围电路设计-辅助模块
摘要
设计一个基于CPLD数字系统开发板外围电路辅助模块的可编程逻辑器件，使得能够在接收到开发板核心模块发送过来的数据时，能够进行对应的A/D转换以及D/A转换，并且能够由8位8段数码管进行直接对数据的循环扫描输出显示，或者对数据进行相应的译码后循环扫描输出。在此辅助模块中，还加有分频器、频率计以及步三相进电机的设计。整个辅助模块的设计过程都在QuartusII平台下进行软件编程以及编译仿真实现，获得仿真波形，并观察结果，对照设计要求。该设计全程采用VHDL语言描述，VHDL语言具有功能强大，设计方式多样、有强大的硬件描述能力、有很
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