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modulelcd(clk,rst,test_mode,lcd_data_in,RS,RW,cont,en,lcd_data_out);

inputclk,rst;

input[1:0]test_mode;

input[15:0]lcd_data_in;

outputRS,RW,cont,en;

output[7:0]lcd_data_out;

wireen_out;

regRS,RW;

reg[3:0]count;

reg[7:0]lcd_data_out;

reg[3:0]state;

wireclk_out,clk_en,cont;

regen_tmp;

parameterWarmup=4b0000,

Funcset=4b0001,

Dspoff=4b0011,

Clsdsp=4b0010,

Modeset=4b0110,

Dspon=4b0111,

Setaddr1=4b0101,

Indata1=4b0100,

Setaddr2=4b1101,

Indata2=4b1100,

Idle=4b1000;

clkdivU1(clk,clk_out);

assigncont=1b0;

always@(posedgeclkornegedgerst)

if(~rst)

en_tmp=1b0;

else

en_tmp=clk_out;

assignen=~clk_outen_tmp;

assignclk_en=~en_tmpclk_out;

always@(posedgeclkornegedgerst)

begin

if(!rst)

begin

count=0;

state=Warmup;

end

else

begin

case(state)

Warmup:

begin

if(clk_en)

beginif(count==4b0111)

begin

state=Funcset;

count=0;

end

else

begin

state=Warmup;

count=count+4b0001;

end

end

end

Funcset:

begin

if(clk_en)

begin

if(count==4b1111)

begin

state=Dspoff;

count=0;

end

else

b

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