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…诚信应考,考试作弊将带来严重后果！
…华南理工大学期末考试
…
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号…《数字系统设计》试卷
位…
座…注意事项：1.考前请将密封线内各项信息填写清楚；
…2.所有答案请直接答在试卷上(或答题纸上)；
线3．考试形式：开（闭）卷；
…
4.本试卷共大题，满分100分，考试时间120分钟。
…
…题号一二三四五总分
…得分
…评卷人
…
…
…一．选择题(每小题2分，共16分)
业…1.大规模可编程器件主要有FPGA、CPLD两类，下列对CPLD结构与工作原理
专…
的描述中，正确的是(C)
…
…A.CPLD即是现场可编程逻辑器件的英文简称；
…B.CPLD是基于查找表结构的可编程逻辑器件；
…C.早期的CPLD是从GAL的结构扩展而来；
…D.在Altera公司生产的器件中，FLEX10K系列属CPLD结构；
_
_)封
_题
_
…
_
_答…2.在VHDL语言中，下列对时钟边沿检测描述中，错误的是(D)
_
_
院不…A.ifclkeventandclk=1then...;
_…
_学B.iffalling_edge(clk)then...;
_内
_
…
_线C.ifclkeventandclk=0then...;
_
…
_D.ifclkstableandnotclk=1then...;
_
封…
_
_
密…
_
_
…
_(3.在VHDL语言中，下列对进程（PROCESS）语句的语句结构及语法规则的描述中，正确
…
…的是(A)
…A.PROCESS为一无限循环语句；敏感信号发生更新时启动进程，执行完成后，等待下一
…次进程启动；.
…
B.敏感信号参数表中，应列出进程中使用的所有输入信号；
…
…C.进程由说明部分、结构体部分、和敏感信号参数表三部分组成；
…D.当前进程中声明的信号也可用于其他进程
号…
学密4.基于EDA软件的FPGA/CPLD设计流程，以下流程中哪个是正确的：(C)
…
…A.原理图/HDL文本输入→适配→综合→时序仿真→编程下载→功能仿真→硬件测试
…B.原理图/HDL文本输入→功能仿真→综合→时序仿真→编程下载→适配→硬件测试；
…C.原理图/HDL文本输入→功能仿真→综合→适配→时序仿真→编程下载→硬件测试
…
D.原理图/HDL文本输入→适配→时序
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