Allegro如何设定线长限制 .pdfVIP

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Allegro如何设定线长限制

Allegro如何设定线长限制

Allegro如何设定线长限制

1,打开allegrosetupelectricalconstraint

spreadsheet--net--routing--relativepropagationdelay

2,鼠标右键system下面的文件名（brd文件名）--creat-

-matchgroup--输入一个自定义的name（比如PCI1)

3,鼠标右键PCI1--membership--matchgroup--选中所有需

要长度设定的net到members

4,pinpairs选longestpinpair，scope选globalrelative

delay--delta:tolerance(mil),在下面填入公差（比如0mil：

100mil）

5,route完成以后actual里面就会有net长度显示，如果全部绿

色则满足规则，所有的net相互之间的长度差别在100mil以内如果是

红色的，则说明不满足规则，看正负分别表示长或者短,调整至绿色ok

VIA的=S=规则

我们一般用0.35mm或者0.5mm的孔，基本原则是纵横比PCB

THICKNESS/VIA8,在此前提下孔径越大，板厂越容易做，但是鉴于

板子的密度和通过电流的大小，需要选取一个合适的孔径

要不要塞孔一般是根据工艺来的，塞孔的目的主要是防止焊接过

程中会有锡珠掉落在孔内，引起短路；大于0.35MM的孔一般用树脂

塞孔，不用绿油塞，为了测试的时候避免效果不好，因为绿油会流动

到另外一面

还有一个目的就是做COATING的时候，如果COATING区域有

大于0.45MM的孔,就要塞上，防止清漆从孔漏到另一面去，引起焊接

不良

BGA底部的过孔：如果不是测试点，都需要塞孔处理，防止短路

及藏锡珠。如果要做为测试点，可以bot面开窗，top面开小窗或者

绿油覆盖都可以。（当BGA的pitch较大时，测试点建议开小窗处理，

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当pitch小于1mm时，建议绿油覆盖）

作为测试点用的过孔在测试面是不能塞孔的

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