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项目练习
一、单项选择题
1.ADC0809的CLOCK引脚的外接时钟源频率通常取()。
A?500Hz B?500KHz C?200Hz D200KHz
2.ADC0809在转换结束,数据输出时()。
A?START须置高电平 B?ALE须置高电平
C?EOC须置高电平 D?OE需置高电平
3.在启动ADC0809进行A/D转换时,START信号需()。
A置高电平 B先置高电平,再置低电平
C置低电平 D?先置低电平,再置高电平,后置低电平
4.图7-2所示的ADC0809的引脚图,当ADDC、ADDB、ADDA为010时,()。
AIN0通道被选择 B?IN1通道被选择 C?IN2通道被选择 D?IN3通道被选中
5.74HC138是一个()。
A?8线输入-3线输出的集成译码器 B?3线输入-8线输出的集成译码器
C?8线输入-3线输出的集成编码器 D?3线输入-8线输出的集成编码器
6.图7-44所示为74HC138芯片引脚图,使能信号有效时,若3、2、1脚输入011,则()。
图7-4474HC138芯片引脚图A?14脚输出低电平 B?
图7-4474HC138芯片引脚图
C?12脚输出低电平 D?9脚输出低电平
7.图7-6所示D锁存器电路,当E=1时,输出()。
A?Q=0 BQ=1 C?Q=D D呈高阻
8.图7-6所示D锁存器电路,当E=1,D=1时,输出Q()。
A?为0 B为1 C保持原态 D呈高阻态
9.图7-6所示D锁存器电路中,当E=0,D=1时,输出Q()。
A?为0 B为1 C保持原态 D呈高阻态
10.图7-14所示是JK触发器的状态转换图,图中“×”()。
A?一定是0 B?一定是1 C? 0或1 D?不存在
11.图7-13所示JK触发器在CP由1变0时刻,J=1、K=1时,输出Q()。
A?=0 B?=1 C?保持不变 D?翻转
12.图7-13所示JK触发器在CP=1,J=1、K=1时,输出Q()。
A?=0 B?=1 C?保持不变 D?翻转
图7-45D触发器状态图13.图7-45所示触发器状态转换图中,在时钟信号有效的条件下,①、②、③
图7-45D触发器状态图
A?1、1、0、0 B?0、1、0、1 C?1、0、1、0 D?0、0、1、1
14.图7-11所示触发器,在CP=1时,若D=0,则()。
A?等于0 B等于1 C保持原态 D不定
15.图7-23所示电路中,若现态Q3Q2Q1Q0=1000,串行输入端D0在第2个脉冲信号之前为1,之后为0,则第3个时钟脉冲后,Q3Q2Q1Q0()。
A?1000 B?0001 C?0011 D?0110
16.图7-23所示电路,若使从D0输入的数据,从Q1输出,需送()。
A?1个时钟脉冲B?2个时钟脉冲C?3个时钟脉冲D?4个时钟脉冲
17.图7-20所示电路中,若现态Q3Q2Q1Q0=1010,CP=1→0时,D3D2D1D0=0110,则次态为()。
A?1010 B?0110 C?1001 D?0101
18.图7-20所示电路中,若现态Q3Q2Q1Q0=0110,CP=0→1时,D3D2D1D0=1110,则次态为()。
A?0110 B?0101 C?1110 D?1001
19.图7-27所示电路如果扩展成8位的DA转换电路,其S7S6S5S4支路所接的权电阻应该是()。
A?R、R/2、R/4、R/8 BR/16、R/32、R/64、R/128
CR、2R、4R、8R D16R、32R、64R、128R
20.图7-29所示逐次比较A/D转换电路中,在启动脉冲作用下,FF0~FF4的输出为()。
A?00000 B?00001 C?10000 D?01000
二、判断题(正确:T,错误:F)
1.ADC0809需要一个启动负脉冲才能启动A/D转换。()
2.当ADC0809转换结束时,转换结束标志EOC=1。()
3.二进制译码器的输入如果为n位,输出端应为2n个。()
4.锁存器和触发器实质是同一种电路的不同叫法。()
5.JK触发器在时钟脉冲下降沿时刻,若J=K=1,则实现状态翻
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