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硬件冗余设计技术容错计算技术
硬件冗余设计技术
ih
第一节硬件表决系统
第二节待命储备系统
第三节混合冗余系统
第四节硬件二模冗余系统
第五节可重构的五模系统
第六节硬件冗余结构综述
硬件冗余设计技术容错计算技术
第一节硬件表决系统
简单的表决系统(TMR)
二NMR系统
三分段表决系统
四.三模-单模自净系统
五.典型表决电路
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第一节硬件表决系统
ih
-.三模表决系统(TMR)
TripeModularRedundancy
三个模块同时执行一样的操作，以
多数相同的输出作为该表决系统的正确
输出。
通常称为三中取二
“少数服从多数”
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第一节硬件表决系统
F=MiM2M3+MiM2M3+MiM2M3+M1M2M3
=M2M3+MiM2+MiM3
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第一节硬件表决系统
■TMR表决电路
JL乙J乙J4JJL4J
=肛叫+画也+加幽3
Ml
M2
M3
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第一节硬件表决系统
■TMR可靠度
设三个模块的可靠度相等，为R⑴。
忽略表决电路的失效。
RTMR⑴=3{♦⑺•7?(0[1-尺(-}+尺⑺•尺⑺•R⑴
=3R\t)-2R\t)
=3e一2力_2尸
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第一节硬件表决系统
i——―
・TMR的MTBF
(MTBF%MR=f®3-21方)力
51
——■--
62
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第一节硬件表决系统
R与RTMR的比较
AtR=〃RTMR=3R2-2R3
10.3680.306
0.6930.50.5
0.50.6070.657
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