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在PCB设计过程中，需要通过设置各种规则，以满足各种信号的阻抗。比如，常用的高速
差分线，我们常控的100欧姆，那么到底走多宽的线以及差分线之间的间距到底是多少，才能
满足设计要求的100欧姆阻抗呢？本文就对Allegro种的基本规则设置做一个详细的讲解。
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注：本文是基于Allegro15版本的。对于16版本不适用。
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首先需要打开规则管理器，可通过以下三种方式打开：
一、点击工具栏上的图标。
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二、点击菜单Setup-Constraints
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三、在命令栏内输入cns并回车
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打开的规则管理器如下：
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在最上面一栏有一个On-lineDRC，这是对画板过程中不停检测是否违反规则，并可产
生DRC。一般我们都默认开启。可以实时查看产生的DRC错误，并加以修正。
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接下来的Spacingruleset是对走线的线间距设置。比如对于时钟线、复位线、及高速
查分线。我们可以再这里面加一规则，使其离其它信号线尽可能的远。
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