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VPO+120VBB
GNDA219VFXI+
VPO-318VFXI-
VPI417GSX
VFRO5TP30616ANLB
VCC615TSX
7
FSR714FSK
DR813DX
BCLKR/CLKSET912BCLKX
MCLKR/PND101MCLKX
1
TP3067外部引脚图
各管脚功能如下：
（1）VPO+接收功率放大器的非倒相输出
（2）GNDA模拟地，所有信号均以该引脚为参考点。
（3）VPO－接收功率放大器的倒相输出
（4）VPI接收功率放大器的倒相输入。
（5）VFRO接收滤波器的模拟输出。
（6）VCC正电源引脚，VCC＝+5V士8%。
（7）FSR接收帧同步脉冲，它启动BCLKR，于是PCM数据接入DR，FSR
为脉冲序列8KHz。
（8）DR接收帧数据输入，PCM数据随着前沿移入DR。
（9）BCLKR＼CLKSEL在FSR的前沿后把数据移入DR的位时钟，其频率
可从64KHz至2048KHz，另一方面它也可能是一个逻辑输入，以此为在同步
模式中的主时钟选择频率1536KHz八1544KHz或2048KHz，BCLKR用在发
送和接收两个方向。
（10）MCLKR＼PDN接收主时钟，其频率可以为1536MH八1544MH二或
2048MHz,它允许与MCLKx异步，但为了获得最佳性能应当与MCLKR同，
当MCLKR连续联在低电位时，CLKx被选用为所有内部定时，当MCLKR
连续工作在高电位时，器件就处于掉电模式。
（11）MCLKY发送主时钟，其频率可以是1536KHz\1544KHz\2048KHz,
它允许与MCLKR同步，同步工作能实现最佳性能。
（12）BCLKx把PCM数据从Dx上移出的位时钟，其频率可从64KHz变
至2048KHz，但必须与MCLKx同步。
（13）DX由FSx启动的三态PCM数据输出
（14）FSX发送帧同步脉冲输入，它启动BCLKx并使Dx上PCM数据移出
Dx。
（15）TSx漏极开路输出端，它在编码时隙输出低电平。
（16）ANLB模拟环回路控制输入，在正常工作时必须置为逻辑“0”，当拉
到逻辑“1时，”发送滤波器和发送前置放大器输出的连接线被断开，改为和接
收功率放大器的
VPO+输出连接。
（17）GSx发送输入放大器的模拟
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