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封装学问大全
1.原理图常见错误：
ERC报告管脚没有接入信号：
创立封装时给管脚定义了I/O属性；
创立元件或放置元件时修改了不全都的grid属性，管脚与线没有连上；
创立元件时pin方向反向，必需非pinname端连线。
元件跑到图纸界外：没有在元件库图表纸中心创立元件。
创立的工程文件网络表只能局部调入pcb：生成netlist时没有选择为global。
当使用自己创立的多局部组成的元件时，千万不要使用annotate.2.PCB中常见错误：
网络载入时报告NODE没有找到：
原理图中的元件使用了pcb库中没有的封装；
原理图中的元件使用了pcb库中名称不全都的封
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