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操千曲尔后晓声，观千剑尔后识器。——刘勰
硬件课程设计实验报告
一、全加器设计
1、实验目的
(1)了解四位全加器的工作原理。
(2)掌握基本组合逻辑电路的FPGA实现。
(3)熟练应用QuartusII进行FPGA开发。
2、实验原理
全加器是由两个加数X和Y以及低位来的进位C作为输入，产
iii-1
生本位和S以及向高位的进位C的逻辑电路。它不但要完成本位二进
ii
制码X和Y相加，而且还要考虑到低一位进位C的逻辑。对于输
iii-1
入为X、Y和C，输出为S和C的情况，根据二进制加法法则可以
iii-1ii
得到全加器的真值表如下表所示：
全加器真值表
XYCSC
iii-1ii
00000
00110
01010
01101
10010
10101
11001
11111
由真值表得到S和C的逻辑表达式经化简后为：
ii
这仅仅是一位的二进制全加器，要完成一个四位的二进制全加器，只
需要把四个级联起来即可。
i
1
操千曲尔后晓声，观千剑尔后识器。——刘勰
3、实验内容
本实验要完成的任务是设计一个四位二进制全加器。具体的实验过
程就是利用实验系统上的拨动
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