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实验报告
实验目的：
1.熟悉软件QuartusⅡ9.1的功能及其操作；
2.熟悉74LS138译码器以及7400与非门等器件；
3.熟悉多输入与非门用7400与非门的方法；
4.熟悉全加器、全减器的功能及原理并设计电路；
5.熟悉DEO开发板的使用；
实验设备：
1.软件QuartusⅡ9.1
2.DEO开发板
3.数据线以及电脑设备
实验内容：
1：用原理图输入方法实现一位全加器。
C1ABSC0
00000
00110
01010
01101
10010
10101
11001
11111
1）打开用QuartusII
2）创建工程项目
3）新建原理图文件
4）绘制原理图
5）编译程序
6）波形仿真验证；
7）目标器件引脚设置
8）下载到DE0开发板验证。
2：用741383-8译码器和7400与非门，用原理图输入方法实现一位全
减器。
C0BADC1
00000
00111
01011
01101
10010
10100
11000
11111
1）打开用QuartusII
2）创建工程项目
3）新建原理图文件
4）绘制原理图
5）编译程序
6）波形仿真验证；
7）目标器件引脚设置
8）下载到DE0开发板验证。
实验结果：
全加器：
（1）设计并绘制原理图：
其中：A是加数
B是被加数
C0是低位的进位信号
S是和数
C1是高位的进位信号
（2）波形仿真验证：
（3）目标器件引脚设置：
全减器：
（4）设计并绘制原理图：
其中：
功能实现C0-B，C0为被减数，B为减数
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