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去留无意，闲看庭前花开花落；宠辱不惊，漫随天外云卷云舒。——《幽窗小记》
实验2含异步清零和同步时钟使能的加法计数器设计
(1)实验目的：
学习计数器的设计、仿真和硬件测试，进一步熟悉VHDL设计技术。
(2)实验原理：
实验程序为例4-22；实验原理参考4.4节(计数器设计)，设计流程参考第5章。
【例4-22】设计一个带有异步复位和同步时钟使能的十进制加法计数器。
LIBRARYIEEE;
USEIEEE.STD_LOGIC_1164.ALL;
USEIEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITYCNT10IS
PORT(CLK,RST,EN:INSTD_LOGIC;
CQ:OUTSTD_LOGIC_VECTOR(3DOWNTO0);
COUT:0UTSTD_LOGIC);
ENDENTITYCNT10;
ARCHITECTUREbehavOFCNT10IS
BEGIN
PROCESS(CLK,RST,EN)
VARIABLECQI:STD_LOGIC_VECTOR(3DOWNTO0);
BEGIN
IFRST=‘1’THENCQI:=(OTHERS=‘0’);--计数器异步复位
ELSIFCLK’EVENTANDCLK=‘1’THEN--检测时钟上升沿
IFEN=‘1’THEN--检测是否允许计数(同步他能)
IFCQI9THENCQI:=CQI+1;--允许计数,检测是否小于9
ELSECQI:=(OTHERS=‘0’);--大于9,计数值清零
ENDIF;
ENDIF;
ENDIF;
IFCQI=9THENCOUT=‘1’;--计数大于9,输出进位信号
ELSECOUT=‘0’;
ENDIF;
CQ=CQI;--将计数值向端口输出
ENDPROCESS;
ENDARCHITECTUREbehav;
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去留无意，闲看庭前花开花落；宠辱不惊，漫随天外云卷云舒。——《幽窗小记》
(3)实验内容1：
在QuartusII上对例4-22进行编辑、编译、综合、适配、仿真。说明例中各语句的作
用。详细描述示例的功能特点，给出其所有信号的时序仿真波形。
提示1：目标器件选择MAX7000S系列的EPM7128SLC84-15。
(4)实验内容2：
引脚锁定以及硬件下载测试(参考5.2节)。引脚锁定后进行编译、下载和硬件测试实验。
将实验过程和实验结果写进实验报告。
提示2：引脚锁定除了参考第5章第2节内容外，具体引脚编号选定应参考“实验附注
资料附注3：万能接插口与结构图信号/与芯片引脚对照表”的“EPM7128S-PL84”栏目。
提示3：选实验电路模式5，参考“实验附注资料
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